头条 ST宣布中国本地造STM32微控制器已开启交付 3 月 23 日消息，意法半导体（ST）今日宣布，中国本地制造的 STM32 通用微控制器现已开启交付。首批由华虹宏力代工的意法半导体 STM32 晶圆产品已陆续发货给国内客户。这一里程碑标志着意法半导体全球供应链战略的重大进展。公司计划 2026 年将有更多 STM32 产品系列（包括高性能、安全及入门级的微控制器）实现本地量产。 最新资讯 赛灵思启动第三届开源硬件大赛Open HW给力中国智造 来自中国电子学会、全国大学生电子设计竞赛组委会、北京工业大学、赛灵思公司及德致伦、依元素、安富利、科通、缘隆、智翔等生态合作伙伴的相关领导，还有包括清华大学、上海交大等在内的全国各大重点工科院校近200多位赛灵思FPGA联合实验室主任及嵌入式系统专家，共同出席了大赛启动仪式。同时出席并致辞的还有中国工程研究院院士、全国大学生电子设计竞赛组委会主任王越院士。 发表于：2011/5/30 基于复数浮点运算的协方差矩阵的FPGA实现 协方差矩阵的计算是信号处理领域的典型运算，是实现多级嵌套维纳滤波器、空间谱估计、相干源个数估计以及仿射不变量模式识别的关键部分，广泛应用于雷达、声呐、数字图像处理等领域。采用FPGA(Field Programmable Gate Array)可以提高该类数字信号处理运算的实时性，是算法工程化的重要环节。但是FPGA不适宜对浮点数的处理，对复杂的不规则计算开发起来也比较困难。故目前国内外协方差运算的FPGA实现都是采用定点运算方式。 发表于：2011/5/27 基于麦克风阵列声源定位系统的FPGA实现 论述了基于麦克风阵列的声源定位技术的基本原理，给出了利用FPGA实现系统各模块的设计方法。重点介绍了其原理和模块的电路实现，给出的基于FPGA设计实验结果表明，系统最大限度发挥了FPGA的优势、简化了系统设计、缩短了设计周期、符合设计要求。 发表于：2011/5/27 FSK／PSK调制的FPGA实现 基于DDS和VHDL硬件描述技术，采用大规模可编程门阵列FPGA，实现了FSK和PSK数字调制。介绍了m伪随机基带码元发生器、跳变检测器和DDS信号发生等模块。系统参数易修改、可移植性强、性能稳定。 发表于：2011/5/27 CPLD的DSP多SPI端口通信设计 SPI通信方式具有硬件连接简单、使用方便等优点，应用广泛。采取硬件和软件相结合的措施，可以确保SPI通信中数据流的同步，实现可靠通信。本文给出了DSP多SPI端口通信的设计与实现过程，讨论了其中的关键技术问题。SPI多端口通信方法基于CPLD实现，易移植，易于实现功能扩展，可广泛应用于各种采用SPI通信方式的自动化装置。 发表于：2011/5/27 张忠谋：台湾半导体教父的“极限制造” 如果"台湾半导体教父"张忠谋没有在1987年创立台积电，至今可能仍是如此。"在这二三十年的半导体时代中，张忠谋的地位无人能及。" 发表于：2011/5/26 WIMAX LDPC码译码器的FPGA实现 设计了基于TDMP-NMS算法的码率码长可配置LDPC码译码器，支持WIMAX标准LDPC码的译码。 通过插入最短的额外时钟周期，使得更新后的节点信息得到了及时利用。采用一种工作于增量模式的基于填充算法的桶形移位寄存器结构，实现了对该标准中576、768、1152、2304 4种码长LDPC 码译码的支持。结果表明所设计的译码器完全能满足WIMAX标准对数据吞吐率的要求。 发表于：2011/5/26 一种改进型surendra背景更新算法的FPGA实现 针对现有的动态背景提取运动目标物体算法复杂且难以在硬件上实现的问题，研究了改进型surendra背景更新算法原理的特点，提出了改进型surendra背景更新算法的硬件结构，并对硬件结构进行综合、仿真后，在FPGA芯片上实现。 发表于：2011/5/26 SpringSoft推出 新产品PROTOLINK PROBE VISUALIZER 加速 FPGA 原型板的验证工作 SpringSoft今天发表ProtoLink™ Probe Visualizer，这款产品能够大幅提升设计能见度，同时简化FPGA 原型板的侦错工作。新推出的Probe Visualizer 采用创新的专利互连技术与软件自动增强功能，搭配领先业界的Verdi™ HDL 侦错平台，不仅能够缩短预制或定制设计原型板的验证时间，还能够提高FPGA 原型板的投资回报率而将其运用在系统芯片(SoC)设计的早期检验阶段。 发表于：2011/5/26 短帧Turbo译码器的FPGA实现 Turbo码虽然具有优异的译码性能，但是由于其译码复杂度高，译码延时大等问题，严重制约了Turbo码在高速通信系统中的应用。因此，如何设计一个简单有效的译码器是目前Turbo码实用化研究的重点。本文主要介绍了短帧Turbo译码器的FPGA实现，并对相关参数和译码结构进行了描述。1几种译码算法比较Turbo码常见的几种译码算法中，MAP算法[1][3]具有最优的译码性能。但因其运算过程中有较多的乘法和指数运算，硬件实现很困难。简化的MAP译码算法是LOG-MAP算法和MAX-LOG-MAP算法，它们将大量的乘法和指数运算转化成了加减、比较运算，大幅度降低了译码的复杂度，便于硬件实现。简化算法中，LOG-MAP算法性能最接近MAP算法，MAX-LOG-MAP算法次之，但由于LOG-MAP算法后面的修正项需要一个查找表，增加了存储器的使用。所以，大多数硬件实现时，在满足系统性能要求的情况下，MAX-LOG-MAP算法是硬件实现的首选。通过仿真发现，采用3GPP的编码和交织方案[2]，在短帧情况下，MAX-LOG-MAP算法同样具有较好的译码性能。如图1所示，帧长为128，迭代6次，BER=10-5的数量级时，MAX 发表于：2011/5/26 <…396397398399400401402403404405…>
