一个低抖动比1 GHz环形VCO的设计与实现-AET-电子技术应用

一个低抖动比1 GHz环形VCO的设计与实现

来源：电子技术应用2012年第12期

田颖1，徐江涛2

1.天津大学仁爱学院信息工程系,天津301636; 2.天津大学电子信息工程学院，天津300072

摘要： 通过对Weigandt模型进行噪声分析，采用一种改进的差分延迟单元结构，成功设计了一个稳定输出1 GHz的环形压控振荡器。同时，采用SMIC 0.18 μm标准CMOS工艺流片，在输出端增加钳位管和正反馈管使输出电位能够快速转变为给定值，已达到高速振荡频率和较低噪声比的效果。流片后测试结果表明，当控制电压为30 μV～800 mV时，输出频率可达740 MHz～1.3 GHz，并与输入电压之间呈现良好的线性性；在中心振荡频率为1 GHz时，噪声电压与信号电压的比满足设计要求。

关键词： 压控振荡器锁相环抖动比 CMOS工艺

中图分类号： TN47
文献标志码： A
文章编号： 0258-7998(2012)12-0045-03

Design and realization of a low jitter ratio 1 GHz ring VCO

Tian Ying1，Xu Jiangtao2

1.Department of Information Engineering，Renai College of Tianjin University，Tianjin 301636，China； 2. School of Electronic Information Engineering，Tianjin University，Tianjin 300072，China

Abstract： Based on the noise analysis of Weigandt model, an improved differential structure of delay cell is adopted to realize a 1 GHz ring VCO in SMIC 0.18 μm standard CMOS process. The clamping diode and positive feedback transistors are added at the output, so the output voltage transits faster to fixed swing. Therefore，the high speed oscillating frequency is achieved while low jitter ratio is guaranteed. The testing result after tape-out shows when control voltage ranges from 30 μV to 800 mV, the output frequency shows good linearity with range from 740 MHz to 1.3 GHz，while the jitter voltage to signal voltage at central 1 GHz is acceptable for the application.

Key words : VCO；PLL；jitter ratio；CMOS process

压控振荡器(VCO)是锁相环系统中的核心元件，很大程度上决定了锁相环的性能(包括输出频率和噪声性能)[1]。环形VCO由于具有易集成、功耗低以及调谐范围大等优点而被广泛应用于目前的集成电路模块中。常见的应用领域包括时钟恢复电路、片上时钟产生电路，以及芯片制造公司用于评估门级延迟和速度功耗积以筛选不合格的晶圆等[2-5]。但是，由于片上环形VCO不仅受内部器件噪声影响，还受耦合到电源和衬底中的由周围数字电路开关引起的噪声影响，因此，环形VCO的相位噪声特性较差。如何优化噪声特性、改善延时单元结构一直是国内外学者研究的热点[7-10]。

    去掉尾电流源以后，负载电阻M3和M4的栅极电压作为电流控制信号。同时，为了提高VoP和VoN的充放电速度以及对称性，在输出点增加了钳位管M7、M8和正反馈管M5、M6。该结构的工作原理如下：
   (1)输入差分对管M1、M2可以较好地抑制输入共模噪声和由电源线干扰引入的噪声。M3、M4栅极电压受偏置电路生成的Vctrl控制，作为差分对管的有源负载，可以抑制器件的1/f噪声。另外，通过改变M3、M4的宽长比可以控制M1、M2中的电流。
   (2)M7和M8管栅极和源级连在一起，即VGS=0。对于增强型工艺，源极和漏极之间有两个背靠背的PN结。这时，不管VDS极性如何，总有一个PN结处于反偏状态，源漏之间没有导电沟道，即IDS=0。在延时单元中，M7、M8组成交叉耦合的二极管，使单级输出摆幅VoP-VoN固定，从而起到限制输出信号摆幅的作用，使延时单元对共模噪声不敏感，既稳定了延迟时间，也提高了系统的线性度。
   (3)M5和M6耦合对管构成了正反馈结构。如M5把VoP作为栅极电压，当VoP增加时，M5中电流IDS增加，M7中无电流，M3中的电流不变，则流经M1中的电流增加，故VoN变小。也就是说，M5与M3管并联增加了输出转换时的增益，从而使得输出信号的上升沿和下降沿变得更快，输出波形的对称化和对电源电压的不敏感特性更好地改善了噪声特性。
3 仿真、流片与测试

   本项目中VCO集成在锁相环模块中，其输出作为CMOS图像传感器芯片的片上时钟。由于芯片中VCO周围分布着大量的数字电路，所以抗干扰特性尤为重要。系统要求VCO稳定输出频率大于800 MHz，且抖动比尽可能小。
   利用SpectreRF工具（Cadence软件）对VCO电路进行PSS分析，其结果如图4所示。由图中可见，当控制电压在30 μV～800 mV时，输出振荡频率线性地从740 MHz～1.3 GHz变化，VCO增益约为7×105 Hz/V。
   图5显示了VCO输出波形的时域特性。与图2相比，VCO输出摆幅变大，且转换速率变得更陡。由式（2）和式（4）可知，VCO噪声特性得到较大改善。Pnoise分析结果如图6所示。

集成了该VCO的锁相环Die交送天津中芯国际集成电路制造公司进行流片。对VCO输出频率先分频再测试，图7为分频后频率为20 MHz时示波器显示的图像。由图中可知，抖动比在可接受的范围内。

本设计的压控振荡器以ECL延时单元为基础，通过Weigandt噪声分析，采用了一种新型延时单元结构。该结构在1.8 V工艺基础上实现了与CMOS标准工艺完全兼容的高速VCO，并且其抖动比满足CMOS图像传感器系统的要求。
参考文献
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