H.264 baseline解码器中运动补偿模块的硬件设计AET-电子技术应用-最丰富的电子设计资源平台

H.264 baseline解码器中运动补偿模块的硬件设计
所属分类：技术论文
上传者：aet
文档大小：129 K

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文档介绍：完成了H.264 baseline解码器中运动补偿模块的Verilog建模，通过了功能验证和综合。该运动补偿模块可用于H.264 baseline解码器的FPGA实现和ASIC实现。
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